Open Access
Numéro
J3eA
Volume 18, 2019
JPCNFM 2018 – 15e journées pédagogiques du CNFM (Coordination nationale pour la formation en micro-électronique et en nanotechnologies)
Numéro d'article 1016
Nombre de pages 9
DOI https://doi.org/10.1051/j3ea/20191016
Publié en ligne 18 octobre 2019
  1. SoCLib Virtual Prototyping Platform, site web officiel: http://www.soclib.fr [Google Scholar]
  2. L. Anghel, M. Benabdenbi et F. Petrot, "System on chip project: Integration of a Motion-JPEG video decoder," 10th European Workshop on Microelectronics Education (EWME), Tallinn, 2014, pp. 167–170. [Google Scholar]
  3. RISC-V Foundation, site web officiel: https://riscv.org/ [Google Scholar]
  4. Rocket Chip Generator, repository officiel : https://github.com/freechipsproject/rocket-chip [Google Scholar]
  5. Wikipedia, https://fr.wikipedia.org/wiki/RISC-V [Google Scholar]
  6. K. Asanović et al., “The Rocket Chip Generator,” Technical Report No. UCB/EECS-2016-17, site web: https://people.eecs.berkeley.edu/~krste/papers/EECS-2016-17.pdf [Google Scholar]
  7. C. Celio, D. Patterson, K. Asanović, The Berkeley Out-of-Order Machine (BOOM) Design Specification, University of California, Berkeley, December 4, 2016. [Google Scholar]
  8. PULPino: An open-source microcontroller system based on RISC-V, site web officiel: https://pulp-platform.org [Google Scholar]
  9. J. Bachrach et al., CHISEL: Constructing Hardware in a Scala Embedded Language, University of California, Berkeley, Design Automation Conference 2012, site web: https://chisel.eecs.berkeley.edu/ [Google Scholar]
  10. A. Waterman, Y. Lee et al. “Spike RISC-V ISA Simulator”, repository officiel: https://github.com/riscv/riscv-isa-sim [Google Scholar]
  11. A. Waterman, K. Asanović, “The RISC-V Instruction Set Manual, Volume II: Privileged Architecture,” May 2017. Site web: https://riscv.org/specifications/privileged-isa/ [Google Scholar]

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