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J3eA
Volume 16, 2017
JPCNFM 2016 – 14e journées pédagogiques du CNFM (Coordination nationale pour la formation en micro-électronique et en nanotechnologies)
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| Article Number | 1020 | |
| Number of page(s) | 5 | |
| DOI | https://doi.org/10.1051/j3ea/20171020 | |
| Published online | 31 janvier 2018 | |
Conception et réalisation de circuits analogiques NMOS : Apprentissage Par Projet de la CAO à la salle blanche
a
INP-ENSEEIHT, Université de Toulouse, 2 Rue Charles Camichel, 31000 Toulouse, France
b
LAAS, Université de Toulouse, CNRS, 7 Avenue du Colonel Roche, 31400 Toulouse, France
c
AIME et pôle CNFM de Toulouse, Université de Toulouse, INSA, 135 avenue de Rangueil, 31077 Toulouse, France
Résumé
Le but de cette étude est de proposer à des étudiants de niveau Master ou Ingénieur de se familiariser avec la chaine de conception et de fabrication de circuits intégrés analogiques sous forme d’Apprentissage Par Projet (APP). Le projet, d’une durée totale de 9 journées, permettra à chaque binôme d’étudiants de réaliser un circuit NMOS personnalisé a partir de données issues de la modélisation de la filière technologique NMOS développée par l’AIME de Toulouse, ainsi que de données de simulation obtenues à l’aide des modèles EKV des transistors issus de cette technologie.
© EDP Sciences 2017
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